連関資料 :: a
資料:4,341件
全体公開 2008/09/22
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国際財政論についてa
- 国際財政論について考えるために、第一章で財政・金融・政府の役割について考察していく。財政は主に国内の問題だったが、グローバル化の流れの中で一国の財政政策が国際的に影響を与えたり、国際的な流れをみて財政政策を決定していく必要性が次第にでてきた。また、金融政策も一国の問題を超えて他国間や世界的な規模での協調が必要となる場面が多くなってきた。それらの協調を達成するためには一国の政府ではもちろん対応することができないため、多国間の協調のための“世界政府”という考え方も出現する。 第二章では世界または地球規模での財政政策や財政活動が求められるようになってきた過程と、それらに必要な重層的ガバナンスやグローバルタックスの問題点やリスクについて考察する。地方、国、世界規模での重層的なガバナンスではそれぞれの考え方や習慣などの文化によってガバナンスの方法が様々であり、重層的なガバナンスでは問題点が多く出現する。重層的なガバナンスの一番外側にあるのが地球規模のガバナンスであると思われる。その地球規模のガバナンスでの歳入となるのがグローバルタックスだが、このグローバルタックスにも問題点があり、一筋縄でいかない現実がある。 第三章では国際財政のこれからを考える。地方、国、世界と段々に重ねられ今日ではグローバルな視点で財政政策を決定していく必要があり、そのためにはグローバルタックスの必要性と重層的なガバナンスの問題点を解決する必要がある。
- 日本 経済 企業 政策 国際 戦争 社会 政治 問題 グローバル
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Article about a Leader
- Who is the richest business man in the world? Or who is the person that always in a ranking list of millionaires? I believe everybody can answer this question. Yes, it is “Bill Gates”. He was born 1955 in Seattle, and founded Microsoft in 1975. I can say he is reputable person. In this report, I give a definition of leaders from an example of Bill Gates. First of all, Leaders do have clear vision, and can inform people on it. At any time they can present their company “should aim, should shape, and want to be”. Bill Gates had these visions clearly, so staffs followed him, when he started Microsoft.
- レポート ビル・ゲイツ リーダー ビジネス論
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SoC設計技術A
- １．SoC開発でIP再利用が必要な理由をムーアの法則にも注目して説明せよ。 ムーアの法則は、米Intel社の設立者ゴードン・ムーア（Gordon E. Moore）が1965年に提唱した、半導体技術の進歩に関する経験則。『半導体チップの集積度は、およそ18カ月で2倍になる』というもの。集積度とはICチップ上に集積されたトランジスタや抵抗などの素子の数を表す。この法則には理論的な論拠や技術的な裏付けがあるわけではないが、多少の差はあるものの、現在までのところは、おおむねこの法則に従って半導体技術は進歩している。今後もこのペースで進歩を続けるためには、様々な技術的な限界を乗り越える必要があるが、過去何度も限界といわれながらもそれを克服してきたことを考えると、今後も当面はこの法則が成立し続ける可能性は高い。 このように半導体チップの集積度は３年で４倍と、進化をどんどん遂げているが、設計生産性は、現状のままでは、３年で約２倍しか向上しない。そのためこの差をどのようにして埋めていくかということが問題となってくる。そこで考え出されたのが「IP再利用」という手段である。 もともと前述の通り、“差”を埋めるためには、より効率の良い開発環境を実現することが必要であり、そのために必要なことがある程度の規格の統一である。
- レポート 理工学 SoC System On Chip 半導体
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SoC設計技術A
- １．SpecC言語／SystemC言語によるシステム仕様からのSoC設計と、HDLによるRTLからの設計を比較してください。両設計手法のカバーできる範囲(HW/SW)、設計者の負荷、設計効率、設計環境に与えるインパクト、設計品質、設計期間、等で比較してください。 表１：システム仕様からのSoC設計とHDLによるRTLからの設計の比較 カバーできる範囲 全てのハードウェア部品に加え、メモリやレジスタファイル、パイプライン設計などのシステム機能 全てのハードウェア部品 設計者の負荷 同じプログラムを作成する場合、システム仕様からの設計はRTLからの設計の約７分の１の記述量で作成することができるのでシステム仕様からの設計が設計者の負荷が小さくなる。 設計効率 検証速度は、システム仕様からの設計のほうがRTLからの設計よりも１０，０００倍速くなるので設計効率はシステム仕様からの設計のほうが良い。 設計環境に与えるインパクト より素早く作成したい場合にはこちらが適切。より詳細に作成したい場合にはこちらが適切。 設計品質 プログラムの記述量がRTLからの設計のほうが多くなるので、設計品質としてはRTLからの設計のほうが良くなる。
- レポート 理工学 SoC System On Chip 半導体
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SoC設計技術A
- １．動的検証と静的検証のメリットとデメリットをまとめよ。 動的検証とは、テストパターンを与えてシミュレーションにより検証を行う方式である。シミュレーションは、入力したテストパターンに対してのみしか、正しいことを保障できないことから、いかに漏れの少ないテストパターンを準備するかが重要である。 以下にそのメリットとデメリットをまとめる。 表１：動的検証のメリット・デメリット メリット デメリット モデルの抽象度に応じた正確さで実行可能。抽象度が高いほど高速。 専用計算機による高速化が出来てない。 パラレル検証による高速化が出来てない。 HWへのマッピングによりタイミングとしての正確な模擬ができないが、等価な機能を模倣して高速に実行できる。 実際に動かすまでの立ち上げ作業に時間がかかる。 設計の変更時に行うマッピングに時間がかかる。 非常に高価。 より実機に近い形で高速に実行できるプログラマブルな試作ボードで検証がしやすい。対象毎に毎回自作すると時間とコストがかかる。 静的検証とは、テストパターンを与えずに行う形式的検証方式である。シミュレーションでは、与えたテストパターンでの正しさしか示せないのに比べ、原理的にはすべての正しさを検証できる。
- レポート 理工学 SoC System On Chip 半導体
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